- 派遣社員
株式会社フェローシップ 東京都小平市勤務
ASICロジック設計・検証エンジニア
ASICロジック設計・検証エンジニア
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月給334,600円~517,300円
アクセス
仕事内容
仕事内容 雇用形態:派遣社員 職種:半導体デバイス設計 本求人は無期雇用派遣です。株式会社フェローシップと期間の定めのない雇用契約を結び、当社の社員として、派遣先の指揮命令のもとで業務に従事します。 【業務内容】 業務要約: ASIC製品に搭載されるセキュリティ機能を有する論理IPの設計および検証業務です。 仕様検討からVerilog HDLを用いたRTL設計、AMBAバス接続制御、EDAツールによる検証、論理合成、各種ドキュメント作成を担当します。 求人概要: 半導体デバイスにおけるセキュリティ要件の高まりに伴い、ハードウェアレベルでの暗号化や改ざん防止を実現するセキュリティ論理IPの重要性は増しています。 本ポジションでは、ASIC製品に実装するセキュリティ機能付き論理IPのロジック設計および機能検証業務を担当します。 AXIやAHBといったAMBAバス規格による接続制御回路の設計をはじめ、RTLコーディングや論理合成、Gateレベルネットリストの検証まで幅広く携わります。 VCSやVerdi、SpyGlassなどのEDAツールを活用した詳細な検証作業を推進します。 高度なハードウェアセキュリティ設計とロジック設計の専門スキルを一貫して高められる環境です。 仕事内容: ・セキュリティ機能を有する論理IPの仕様検討およびRTL設計 ・Verilog HDLを用いた論理回路設計およびコーディング ・AXIおよびAHBなどのAMBAバス規格に基づく接続制御回路の設計 ・VCS、Verdi、SpyGlassを用いたEDA論理検証およびシミュレーション実行 ・SystemVerilogアサーション(SVA)を用いたプロパティ検証 ・論理合成の実施およびGateレベルネットリストの検証 ・Subversionを用いた設計データおよびソースコードのバージョン管理 ・設計仕様書や検証結果報告書など各種ドキュメントの作成 開発環境・言語・ツール情報: Verilog HDL、SystemVerilog、VCS、Verdi、Spyglass、AMBA、AXI、AHB、Subversion、Linux、JasperGold、DesignCompiler、PrimeTime、Formality、Excel、Word、Outlook 【キーワード】 半導体、ASIC、ロジック設計、RTL設計、Verilog HDL、EDA検証、AMBA、AXI、論理合成、セキュリティIP 【就業先・働き方】 東京都小平市上水本町5-20-1 一橋学園駅 (西武多摩湖線) 徒歩15分 恋ヶ窪駅 (西武国分寺線) 徒歩15分 ルネサス武蔵 バス停 (西武バス 寺61/寺62) 徒歩1分 上水本町五丁目 バス停 (西武バス 寺61/寺62) 徒歩2分
対象となる方
求めている人材 【必須条件】 ・RTL設計(Verilog HDL) ・EDA検証経験(vcs, verdi, spyglass) ・SystemVerilogアサーション(SVA)経験 ・バージョン管理ツールの使用経験(Subversion) ・AMBAバス規格設計経験(AXI, AHB) ・Linux CUIコマンドを扱えること ・Microsoft Officeソフトを扱えること(Excel, Word, Outlook) 【歓迎条件】 ・機能安全設計・評価 経験 ・暗号規格(共通鍵暗号、公開鍵暗号、ハッシュ、楕円曲線など) ・JasperGold, DesignCompiler, PrimeTime, Formality の使用経験
職種
半導体デバイス設計
仕事の特徴
- 副業・WワークOK
- 無期雇用派遣
- 資格取得支援あり
- 固定時間制
- 研修あり
給与/待遇
試用期間
待遇・福利厚生
応募情報
選考プロセス
選考プロセス 面接2回(いずれもオンライン)です。当社は多くの求人を掲載しておりますが、重複応募はお控えください。
会社情報
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交通・アクセス 配属先により異なります
月給334,600円~517,300円
勤務時間詳細 実働時間:1日あたり7時間45分 平均勤務日数:1ヶ月あたり20日 〜 22日 8:45~17:15(実働7時間45分・休憩45分)
- 固定時間制
掲載開始日:2026/10/26
原稿ID:5ef9aeea189b0a82
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特徴
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