- 正社員
FPTジャパンホールディングス株式会社
システムエンジニア_fptjpnhld-109
要件定義から設計開発まで一貫して携わり技術を磨ける/グローバル案件で専門性を磨ける
年俸5,000,000円~10,000,000円
この求人は職業紹介事業者による紹介案件です
応募情報は職業紹介事業者に送信されます
勤務地
勤務地: 東京都港区三田三丁目5番19号 住友不動産東京三田ガーデンタワー 33階
仕事内容
アピールポイント: ■日本の労働人口不足から、今後絶対に必要となってくるオフショア開発連携。今からベトナムの優秀なエンジニアと連携する経験を積み、市場価値UP&グローバルに活躍可能な人材に! ■社員数4800名超え、売上700億円、平均成長率30%の超成長企業!取引先は大手上場企業が9割(世界20カ国・FortuneGlobal500の100社以上)! ■ベトナム系外資の同社の風土の特徴はメンバーの向上心の高さ、アットホームな雰囲気、そして自由度。 意思決定も速く柔軟な環境で、自由に伸び伸びと働けます。 社内はベトナム籍を中心に様々な国籍の方が在籍しております。 公用語は日本語です(日本語が話せる社員がほとんどです)
仕事内容: ・会社紹介(FPT Semiconductor) FPT Semiconductor は、 ベトナムで急成長する半導体産業を牽引する企業として、 グローバル市場向けに 電源管理IC(Power Management IC) および IoT IC の設計を行っています。 FPT Corporation の一員として、 長期的なパートナーシップの構築、イノベーションの推進、 そして世界の技術エコシステムへの貢献を目指しています。 品質と精度に徹底的にこだわり、最先端技術と専門チームにより、 国内外のお客様の多様なニーズに応えています。 「信頼性×革新」で、グローバル市場に挑戦するエンジニア を募集しています。 将来的に設計全体をリードするTech Lead/ Architectへのステップアップの機会があります。 ・Physical Designフロー全体の推進 Floorplan~PnR~Signoff~GDS Outまで担当し、 ブロックレベルのPhysical DesignおよびSignoff 収束を自立して推進(Fusion Compiler等の実務経験)。 Timing、Power、Area(PPA)を総合的に最適化し、 設計収束をリード。 ・設計課題の解析・改善 STA、IR Drop、クロストーク等の課題を分析し、 配置配線やECOによる改善を実施。 ・タイミング解析・収束対応 SDCの作成・管理、STA、およびタイミング収束に向けた最適化を推進。 ・Physical Verification/Signoff対応 DRC/LVS、Timing Signoff、IR/EM Signoff等の課題を解決し、Tape out品質を確保。 ・関連部門との連携 Front-end、DFT、STA等の関連チームと連携し、 設計品質の確保および上流工程へのフィードバックを実施。
対象となる方
求める人材: 【必須要件】 ・電子工学/電気工学/コンピュータ工学、または同等の学士号 ・フィジカルデザインの実務経験 5年以上 ・Floorplan~PnR~SignoffまでのPDフロー全体におけるハンズオン経験 ・Fusion Compiler、Innovus等のPhysical Designツールの実務経験 ・CTS(Clock Tree Synthesis)構築およびTiming Closureの経験 ・タイミングレポートを解析し、違反の原因特定および改善戦略策定ができること ・物理レイアウト検証(DRC/LVS等)の経験 ・Timing、IR/EM等のSignoff課題への対応経験
仕事の特徴
- 固定時間制
給与/待遇
試用期間
待遇・福利厚生
その他
応募情報
採用予定人数
常時募集
紹介企業情報
会社名
株式会社富士誇
事業内容
人事・人材サービス
所在住所
1000005 東京都千代田区丸の内1-6-6日本生命丸の内ビル 21F
代表者
可野 誉大
代表電話番号
0368598412
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年俸5,000,000円~10,000,000円
勤務時間・曜日: ・9:00〜18:00 (所定労働時間:8時間0分、休憩時間:60分) ※客先常駐時は常駐先の所定勤務時間に従う。 ・時間外労働:あり(平均月15時間程度) ※部署・案件によって異なります。
- 固定時間制
掲載開始日:2026/08/17
原稿ID:ea227ba089665518
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勤務地
特徴
東京都
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