- 派遣社員
株式会社フェローシップ 東京都品川区西五反田勤務
デジタル回路設計エンジニア
Verilogの知見で、半導体のRTL設計を担う
交通・アクセス 五反田駅(JR山手線・都営浅草線・東急池上線)から徒歩3分地図を見る
月給350,600円~467,900円
アクセス
仕事内容
仕事内容 雇用形態:派遣社員 職種:半導体デバイス設計 本求人は、株式会社フェローシップの正社員としての採用となります。 当社と期間の定めのない雇用契約を結び、クライアントの指揮命令のもとで業務を担当します。 【募集ポジション】 半導体開発におけるデジタル回路の論理設計プロジェクトです。 Verilogを活用したRTLの記述からシミュレーションを用いた機能検証までを担当します。 システム仕様に基づくアーキテクチャの検討やモジュール設計を通じて高品質なハードウェア設計を実現します。 最先端のEDAツールを活用しデジタル回路設計の専門的な知見を存分に活かせる環境です。 【この仕事で担当できること】 ✅ Verilogの知見で、半導体のRTL設計を担う 【具体的な仕事内容】 ・仕様書に基づくデジタル回路のRTL設計およびコーディング。 ・Verilogを用いたシミュレーション環境の構築および機能検証の実施。 ・回路の最適化および設計ドキュメントの作成。 【開発・業務環境】 Verilog、RTL、EDAツール、ASIC、FPGA 【配属後のサポート】 営業担当が伴走し、業務の状況や今後の希望を確認します。現場での成果の共有や評価の回収もサポートします。 業務内容の変更の範囲:会社の定める範囲
対象となる方
求めている人材 【必須条件】 ・VerilogまたはVHDLを用いたRTL設計の実務経験 ・デジタル回路設計の基礎的な知識 【歓迎条件】 ・論理合成やタイミング検証の実施経験 ・ASICまたはFPGAの開発経験 ・テストベンチの作成およびシミュレーションによる機能検証経験
職種
半導体デバイス設計
仕事の特徴
- 副業・WワークOK
- 無期雇用派遣
- 資格取得支援あり
- 固定時間制
- 平日のみOK
- 研修あり
- 長期歓迎
- フルタイム歓迎
- 長期休暇あり
- 土日祝休み
給与/待遇
試用期間
待遇・福利厚生
応募情報
選考プロセス
選考プロセス 面接2回(いずれもオンライン)です。 複数の求人への重複応募はお控えください。
会社情報
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交通・アクセス 五反田駅(JR山手線・都営浅草線・東急池上線)から徒歩3分
月給350,600円~467,900円
勤務時間詳細 実働時間:1日あたり8時間 平均勤務日数:1ヶ月あたり20日 〜 22日 勤務時間:9:00~18:00(休憩1時間)
- 平日のみOK
- 土日祝休み
- 固定時間制
- フルタイム歓迎
掲載開始日:2026/10/17
原稿ID:cf7161889de5b94f
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勤務地
特徴
東京都
東京23区
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